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详解差分晶振输出

发表时间:2019年9月15日 作者:管理员 类目:晶振 浏览:1008
   

差分晶振,顾名思义就是输出是差分信号的晶振,一般是为FPGA或CPLD提供稳定时钟信号,由于其单价较高,通常都在20RMB/PCS以上,故选择一款稳定,高质量的晶振十分必要,主流差分晶振都是6脚贴片封装,常见的尺寸有7050和5032,当然也有更小的3225封装体积,主要分为LVDS和LVPECL输出,这两款最为常用。

差分晶振是指输出差分信号使用2种相位彼此完全相反的信号,从而消除了共模噪声,并产生一个更高性能的系统。许多高性能的协议使用差分信号,如SATA,SAS,光纤通信,10G以太网等等.许多高性能协议使用差分信号,如SATA、SAS、光纤通信、10G以太网等。差分晶振应用领域有,高速千兆以太网、光纤通道、存储区域网、SONET,企业服务器,SAS/SATA,微处理器/DSP/ FPGA,宽带接入,智能电网。

LVPECL即Low Voltage PosiTIve Emitter-Couple Logic,也就是低压正发射极耦合逻辑,使用3.3V或2.5V电源。想要了解LVPECL电路,我们要首先认知PECL电路。PECL即PosiTIve Emitter-Couple Logic,也就是正发射极耦合逻辑的意思,使用5.0V电源。PECL 是由ECL 演变而来的,ECL 即Emitter-Couple Logic,也就是发射极耦合逻辑。该电路是一种非饱和型的数字逻辑电路,电路内晶体管工作在线性区或截止区,速度不受少数载流子的存储时间的限制,所以它是现有各种逻辑电路中速度最快的一种, 能满足高达10Gbps工作速率。ECL 有两个供电电压VCC和VEE。当VEE接地时,VCC接正电压时,这时的逻辑称为PECL;当VCC 接地时,VEE接负电压时,这时的逻辑成为NECL,VEE一般接-5.2V电源;一般狭义的ECL 就是指NECL。由于PECL/LVPECL可以和系统内其他电路共用一个正电源供电,所以PECL/ LVPECL相对于ECL应用更为广泛。起初的PECL器件是将VCC接+5V,后来为了直接利用广泛使用的3.3V和2.5V电压,出现了VCC=3.3V/2.5V的LVPECL(Low Voltage PECL)。

LVDS(Low Voltage Differential Signaling)它是一种低摆幅的差分信号技术,它使得信号能够在差分PCB 线对或平衡电缆上以几百的Mbps 的速率传输,其低压幅以及低电流驱动输出实现了低噪声以及低功耗。LVDS(Low Voltage Differential Signaling)是一种小振幅差分信号技术,LVDS信号传输一般由三部分组成:差分信号发送器,差分信号互联器,差分信号接收器。

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